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반도체 스터디 2회차 내용 정리

반도체 공정을 더 깊이 이해하는 핵심 인사이트

반도체는 단순히 회로를 작게 만드는 기술이 아니라, 웨이퍼의 결정면, 계면 결함, 노광 파장, CMP 평탄화, 초순수 세정, 장비 소모품 관리가 모두 연결되어 최종 수율(Yield)을 결정하는 종합 공정이다. 이번 글에서는 스터디에서 나온 질문을 바탕으로 2026년 반도체 공정 트렌드까지 함께 정리한다.

1. 왜 반도체는 (100) 실리콘 웨이퍼를 사용할까?

현재 삼성전자, SK하이닉스, TSMC 등 대부분의 첨단 CMOS 공정에서는 (100) 방향의 단결정 실리콘 웨이퍼를 사용한다. 그 이유는 단순히 결정을 성장시키기 쉬워서가 아니라, 실리콘과 산화막(SiO₂)이 만나는 계면(Interface)의 품질이 우수하기 때문이다.

MOSFET은 실리콘 표면에 얇은 산화막을 형성하고, 그 위에 게이트를 만들어 전자의 흐름을 제어한다. 이때 산화막과 실리콘 사이 계면에 결함이 많으면 전자가 이동하다가 붙잡히는 Trap이 증가한다. 그 결과 이동도 감소, 문턱전압 변화, 누설전류 증가가 발생하여 소자 성능과 수율이 떨어진다.

(100)면은 Si-SiO₂ 계면 결함 밀도가 상대적으로 낮아 전자가 안정적으로 이동할 수 있다. 반면 (111)면은 표면 원자 배열 특성상 미결합 상태가 더 많이 남기 쉬워 계면 트랩이 증가할 수 있다.

핵심 포인트
(100) 웨이퍼는 산화막 계면 결함이 적어 최신 CMOS 공정에서 표준으로 사용된다.

그림 1. (100)과 (111) 결정면의 원자 배열 비교

(첨부 이미지 : (100)면과 (111)면에서 산화막 계면 결함, Dangling Bond, Interface Trap 차이를 비교하는 선명한 기술 인포그래픽)

2. Dangling Bond와 Interface Trap은 무엇일까?

실리콘 원자는 내부에서 주변 네 개의 실리콘 원자와 공유결합(Covalent Bond)을 형성한다. 하지만 웨이퍼를 절단하거나 표면이 만들어지면 가장 바깥쪽 원자들은 결합할 상대를 잃는다. 이처럼 결합하지 못한 전자를 가진 상태를 Dangling Bond라고 한다.

실리콘 내부

Si ─ Si ─ Si
│    │    │
Si ─ Si ─ Si

표면 생성 후

Si ─ Si

     ●  ← Dangling Bond

산화막 성장 과정에서 대부분의 Dangling Bond는 산소와 결합하여 안정화되지만, 일부는 그대로 남아 전자를 붙잡는 Interface Trap으로 작용한다. 이 Trap은 전자의 이동을 방해하고, 소자의 신뢰성과 균일성을 저하시킨다.

특히 나노미터급 공정에서는 작은 계면 결함 하나도 트랜지스터 특성 편차로 이어질 수 있다. 따라서 최신 공정에서는 웨이퍼 결정면 선택, 산화막 성장 조건, 계면 패시베이션, 열처리 공정까지 모두 정밀하게 관리한다.

3. 왜 미세공정일수록 빛의 파장은 짧아져야 할까?

포토리소그래피는 마스크에 그려진 회로 패턴을 빛으로 웨이퍼 위에 전사하는 공정이다. 그런데 빛은 파동이기 때문에 마스크의 작은 틈을 지나면서 퍼지는 회절(Diffraction)이 발생한다. 파장이 길수록 회절이 심해지고, 패턴은 흐려진다.

따라서 공정이 미세해질수록 더 짧은 파장의 빛이 필요하다. 반도체 노광 기술은 g-line, i-line, KrF, ArF를 거쳐 현재는 EUV(Extreme Ultraviolet, 13.5 nm) 중심으로 발전했다.

노광 기술 파장 의미
g-line 436 nm 초기 광학 노광
i-line 365 nm 성숙 공정
KrF 248 nm DUV 공정
ArF 193 nm 고해상도 DUV
EUV 13.5 nm 첨단 미세공정 핵심

2026년 기준 첨단 로직 공정은 EUV를 기반으로 하고 있으며, 더 미세한 패턴 구현을 위해 High-NA EUV가 차세대 핵심 기술로 주목받고 있다.

그림 2. 파장과 회절의 관계

(첨부 이미지 : 긴 파장은 회절이 심해 패턴이 흐려지고, 짧은 파장은 빛이 덜 퍼져 미세 패턴이 선명하게 형성되는 비교 그림)

주의
노을이 붉게 보이는 현상은 회절이 아니라 주로 레일리 산란(Rayleigh Scattering) 때문이다. 짧은 파장인 파란빛은 대기 중에서 많이 산란되고, 긴 파장인 붉은빛은 상대적으로 멀리 전달된다.

4. CMP는 왜 거의 모든 공정에서 반복될까?

반도체 공정은 증착과 식각을 수십 번 반복하며 층을 쌓아가는 과정이다. 이 과정이 반복되면 웨이퍼 표면에는 단차가 누적된다. 표면이 평평하지 않으면 포토리소그래피에서 초점이 맞지 않아 패턴이 흐려지고, 이후 식각과 배선 공정에서도 불균일이 발생한다.

이 문제를 해결하는 공정이 CMP(Chemical Mechanical Polishing)이다. CMP는 연마 패드와 압력으로 표면을 기계적으로 깎고, 슬러리의 화학 반응으로 표면을 선택적으로 제거하는 화학적·기계적 복합 평탄화 공정이다.

CMP는 STI, 게이트 구조, 절연막, 금속 배선, 후공정 적층 구조 등 다양한 단계에서 사용된다. 특히 3D NAND나 첨단 로직처럼 층이 많아질수록 CMP 균일도는 수율과 직결된다.

그림 3. CMP 공정 원리

(첨부 이미지 : 연마 패드, 슬러리, 압력, 회전이 함께 작용하여 웨이퍼 표면을 평탄화하는 CMP 공정 모식도)

현업 인사이트
CMP는 단순 연마 공정이 아니라 다음 포토 공정의 초점 허용 깊이와 식각 균일도를 확보하기 위한 핵심 공정이다.

5. 초순수(UPW)는 왜 하루 수십만 톤이 필요할까?

반도체 제조에서는 공정이 끝날 때마다 세정이 반복된다. 식각 후 남은 부산물, CMP 후 슬러리 잔류물, 이온주입 후 오염, 포토 공정 후 유기물 등을 제거하지 않으면 웨이퍼 표면의 미세 결함이 증가한다.

이때 사용하는 물은 일반 물이 아니라 초순수(UPW, Ultra Pure Water)이다. 초순수는 금속 이온, 유기물, 미생물, 파티클을 극도로 제거한 물이며, 나노미터급 공정에서는 초순수의 품질 자체가 결함 관리의 핵심이 된다.

그래서 반도체 공장 부지 선정에서는 전력뿐만 아니라 용수 확보, 폐수 처리, 재이용 시스템이 매우 중요하다. 2026년 반도체 클러스터 경쟁에서도 공업용수와 친환경 물 재이용 기술은 핵심 인프라 이슈이다.

그림 4. 초순수 제조 및 사용 개념도

(첨부 이미지 : 원수에서 전처리, 역삼투압, 이온교환, UV 산화, 초미세 필터를 거쳐 웨이퍼 세정에 사용되는 흐름도)

6. 단결정 실리콘은 웨이퍼에만 사용할까?

단결정 실리콘은 웨이퍼뿐만 아니라 반도체 장비 내부의 소모품에도 사용된다. 플라즈마 식각 장비에서는 공정 균일도를 확보하기 위해 웨이퍼 주변부와 전극 구조를 정밀하게 제어해야 한다.

대표적인 부품은 Focus Ring, Electrode, Shower Head, ESC(Electrostatic Chuck)이다. 특히 Focus Ring은 웨이퍼 가장자리까지 플라즈마 밀도를 균일하게 유지하여 Edge 영역의 식각 균일도를 높인다.

Focus Ring이 마모되면 웨이퍼 중심부와 가장자리의 식각 속도가 달라지고, 이는 패턴 CD 편차와 수율 저하로 이어진다. 따라서 장비 소모품 관리도 단순 유지보수가 아니라 공정 품질관리의 일부이다.

그림 5. Focus Ring이 플라즈마 균일도에 미치는 영향

(첨부 이미지 : 정상 Focus Ring과 마모된 Focus Ring에서 웨이퍼 가장자리 플라즈마 밀도와 식각 균일도가 달라지는 비교 그림)

7. 반도체 공정에서 알아두면 좋은 화학 이야기

반도체 공정은 전자공학뿐 아니라 화학과 재료공학의 비중이 매우 크다. 대표적인 예가 불산(HF)이다. HF는 산화막(SiO₂)을 식각하는 데 사용되지만, 인체에는 매우 위험하다.

HF가 피부를 통과하면 생성된 F⁻ 이온이 체내의 Ca²⁺, Mg²⁺와 강하게 결합한다. 특히 칼슘을 빼앗기 때문에 뼈와 신경계 손상, 심한 경우 심장 기능 이상까지 유발할 수 있다. 그래서 반도체 공장에서는 HF를 가장 엄격하게 관리되는 화학물질 중 하나로 취급한다.

또 다른 예로 나트륨(Na)은 물과 격렬하게 반응한다. 나트륨은 1족 알칼리 금속으로 최외각 전자 1개를 쉽게 잃기 때문에 물과 만나면 수소와 열이 발생한다.

2Na + 2H₂O → 2NaOH + H₂ + 열

발생한 수소와 반응열 때문에 폭발처럼 보이며, 나트륨은 아르곤(Ar) 같은 비활성기체 분위기 또는 광유 속에서 보관한다.

8. 현업에서는 이것을 가장 중요하게 본다

반도체 공정에서 중요한 것은 개별 공정을 따로 외우는 것이 아니라, 모든 공정이 어떻게 연결되는지 이해하는 것이다. 결정면 선택은 계면 품질을 결정하고, 계면 품질은 트랜지스터 이동도와 신뢰성을 결정한다. CMP는 표면 평탄도를 확보해 포토 공정의 정밀도를 유지하고, 초순수 세정은 오염을 줄여 결함을 방지한다.

결국 모든 과정은 하나의 목표로 연결된다.

결함(Defect)을 줄여 수율(Yield)을 높이는 것

2026년 반도체 산업에서는 GAA(Gate-All-Around), High-NA EUV, HBM, 첨단 패키징, AI 반도체가 핵심 트렌드이다. 하지만 이러한 첨단 기술의 기반에는 여전히 고품질 웨이퍼, 계면 결함 관리, CMP 평탄화, 초순수 세정, 장비 소모품 관리가 있다.

이번 글 요약

  • (100) 웨이퍼는 Si-SiO₂ 계면 결함이 적어 최신 CMOS 공정의 표준으로 사용된다.
  • Dangling Bond, CMP, UPW는 모두 결함을 줄이고 수율을 높이기 위한 핵심 개념이다.
  • 2026년의 GAA, EUV, HBM, AI 반도체 시대에도 기본 공정 품질관리가 반도체 경쟁력의 핵심이다.

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